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Digital CMOS circuit design.
パスカル研究会 コロナ社 マルコ・アナラトーネ 平野浩太郎 富田昌宏
MOSトランジスタの特性製造工程論理設計回路設計基本回路の設計ドライバとI/Oバッファの設計付録(レイアウト;配線容量の計算;第5.4.2節の図;式〈7‐3〉による遅延時間の最小化;図7‐10に関連した式;記号と物理定数)
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[BOOKデータベースより]
MOSトランジスタの特性
製造工程
論理設計
回路設計
基本回路の設計
ドライバとI/Oバッファの設計
付録(レイアウト;配線容量の計算;第5.4.2節の図;式〈7‐3〉による遅延時間の最小化;図7‐10に関連した式;記号と物理定数)