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価格：1,540円（本体1,400円＋税）
【2013年06月発売】
価格：1,650円（本体1,500円＋税）
【2023年08月発売】
価格：1,100円（本体1,000円＋税）
【2007年09月発売】
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[BOOKデータベースより]
ＨＤＬは、高い抽象度でハードウェアの動作を記述することを目的に開発されました。本書は、順序同期回路をＳｙｓｔｅｍＶｅｒｉｌｏｇで記述しＬＳＩやＦＰＧＡに実装したい設計者向けに、設計事例をもとに解説しています。
第１章 ＳｙｓｔｅｍＶｅｒｉｌｏｇとは
[日販商品データベースより]第２章 ＦＰＧＡへの実装入門
第３章 ディジタル回路入門
第４章 ＳｙｓｔｅｍＶｅｒｉｌｏｇによる順序回路
第５章 ＳｙｓｔｅｍＶｅｒｉｌｏｇによるプロセッサの設計と実装
第６章 ＳｙｓｔｅｍＶｅｒｉｌｏｇによるＡＳＩＣ設計
第７章 ＳｙｓｔｅｍＶｅｒｉｌｏｇとＶｅｒｉｌｏｇ ＨＤＬの対比と記述の罠
SystemVerilogによる回路設計を実践的に解説
SystemVerilogによるFPGA/ASIC 設計方法を解説する入門書です。
SystemVerilogは、はデジタル回路設計のデファクトスタンダードであるVerilog HDLを拡張した言語で、検証に関する機能が強化されています。Verilog HDLは、ライバルであるVHDLに比べて比較的書きやすい言語といわれています。
本書は、若い技術者や学生向けに最近のSystemVerilogによるデジタル回路設計を解説するものです。FPGAへの実装やデジタル回路自体の基礎からSystemVerilogによるRISC V（リスク ファイブ）設計、Verilog HDLと比較しての注意点など、実践的な内容を解説しています。